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EDA原理及Verilog HDL實現：從晶體管、門電路到Xilinx Vivado的數字系統設計

為了解決ip設計流程的問題，作者何賓 這樣論述：

本書是為高等學校電子信息類及相關專業編寫的數字系統設計 教材，共分為11章，主要包括數字邏輯基礎、可編程邏輯器件工藝和結構、Vivado集成開發環境IP設計流程、Vivado集成開發環境Verilog HDL設計流程 、Verilog HDL語言規范、基本數字單元Verilog HDL描述、Verilog HDL數字系統設計和實現、創建和封裝用戶IP設計和實現、Vivado調試工具原理及實現 、數字系統設計方法和數模混合系統設計。本書以Xilinx Artix 7系列FPGA器件和Xilinx最新一代的Vivado 2015.4集成開發環境為設計平台，根據數字系統設計課程的

教學要求以及作者多年的教學經驗，將本科傳統的數字電子技術（數字邏輯）課程與復雜數字系統設計課程相結合，遵循循序漸進、由淺入深的原則，內容涵蓋了晶體管、門電路、數字邏輯理論、組合邏輯和時序邏輯、可編程邏輯器件結構、Vivado集成開發環境設計流程、Verilog HDL 語言、Verilog HDL復雜數字系統設計、IP封裝與調用、在線邏輯分析儀工具以及數模混合系統設計等方面。本書可作為本科生和研究生學習數字系統設計等相關課程的教材，或作為從事Xilinx FPGA設計的工程技術人員的參考用書，也可作為Xilinx大學計划培訓的授課教材。何賓，著名的嵌入式系統專家和EDA技術專家，長期從事嵌入式

系統和電子設計自動化方面的教學和科研工作，與全球知名的半導體廠商租EDA工具廠商保持緊密合作，致力於推動國內高校電子信息技術的教學改革。目前已經出版嵌入式系統和電子設計自動化方面的著作20余部，內容涵蓋電路仿真、電路設計、現場可編程門陣列、單片機、嵌入式系統等。代表作有《Xilinx FPGA數字設計》、《XilinxAllProgrammableZynq-7000SoC設計指南》、《Xilinx FPGA數字信號處理指南》、《Xilinx FPGA設計指南》、《AltiumDesigner13.0電路設計、仿真與驗證指南》、《STC單片機原理及應用》。

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類比與混合訊號矽智財之行為模型設計與應用經驗 研究案例：展頻時脈產生器類比行為模型設計與應用

為了解決ip設計流程的問題，作者邱堉增 這樣論述：

本論文研製之 類比與混合訊號矽智財之行為模型設計與應用經驗 研究案例：展頻時脈產生器類比行為模型設計與應用　　本文介紹是針對一個類比與混合訊號 (Analog/Mixed-signal ，AMS) 矽智財(IP) ，利用Verilog-A 硬體描述語言先建構一套類比行為模型資料庫(Analog Behavioral Model)，並配合混合訊號模擬器、混合訊號模擬的方法。這樣高階層的模型擁有不錯的精準度，因此能夠取代或混合現有電路來做快速的系統驗證，通過這種方法，來探討加速整個AMS IP設計流程的綜合應用方法與實作。研究案例是以展頻時

脈產生器(Spread Spectrum Clock Generator, SSCG) 電路架構，作為建立類比行為模型資料庫的參考，匯集了三種PLL（鎖相迴路）的電路架構，在Cadence的AMS設計環境的建構行為模型、模組與一個泛用型的混合驗證平台，並在此環境中進行模型確認與各種類比與混合訊號的模擬驗證。第一個模型應用的目的是為了在混合訊號電路的設計初期，能輔助數位設計工程師來快速驗證數位電路部分功能的可能性。第二個應用的目的是改善一個PLL(Phase Loop Locked, PLL) 的設計分析流程，並發展一套快速設計分析的方法論，以一個非整數PLL的設計分析流程的應用，可看出模擬速度

與結果的效率大幅提昇，減少重新設計(re-design)。第三個應用是藉由類比行為模型資料庫發展一個基本的PLL IP 自動化的行為模型產生器，用以改善模型建立與確認的工作流程。